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1.FPGA设计技巧之gVim设计模板(1)

FPGA工程师都知道,verilog代码绝大部分都是always语句,结构基本上都是一致的,为了减少重复性的工作,让工程师专注于设计实现,明德扬精心制作了常用模板,只要你安装好明德扬提供的GVIM,就能使用这些模板了。

明德扬模板分享1.pdf

2.FPGA设计技巧之gVim设计模板(2)

FPGA工程师都知道,Verilog代码绝大部分都是always语句,结构基本上都是一致的,为了减少重复性的工作,让工程师专注于设计实现,明德扬精心制作了常用模板,只要你安装好明德扬提供的GVIM,就能使用这些模板了。

明德扬模板分享2.pdf

3.FPGA设计技巧之常用模块划分(1)

模块划分,顾名思义是指模块的划分。但是,明德扬提出的模块划分,是广义的“模块划分”。后续所提及的“模块划分”,不单单指模块的划分,还包括模块划分好后,模块的端口及模块之间数据流向的确定。

明德扬FPGA模块划分方法(1).pdf

4.FPGA设计技巧之常用模块划分(2)

下面给出明德扬明德扬在FPGA/ASIC设计领域多年的项目经历,总结出来五个常用的模块交互架构,读者在进行项目设计时,可结合明德扬模块划分原则,参照“模块划分常用架构”进行模块划分。

模块划分常用架构(2).pdf


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